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| Issue Date | Title | Author(s) | Type |
|---|---|---|---|
| 2015 | A 6.6 mW, -94 dBc/Hz, 1.0-to-4.5 GHz phase-lock loop in 65-nm CMOS | 박성민 | Conference Paper |
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-Subject
- 1 PLL
- 1 ring VCO
- 1 tuning range
-Date issued
- 1 2015
03760 서울특별시 서대문구 이화여대길 52 이화여자대학교 도서관
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